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Ein voller 112 Gbit/s PAM4 Chip-zu-Chip-Kanal routet von einem Xilinx GTM-Testchip durch mehrere Twinax-Flyover™-Kabelkonfektionen, eine ExaMAX® Backplane-Kabelkonfektion und zurück zum Xilinx GTM-Testchip. Die traditionelle Backplane-Architektur wird beibehalten, jedoch mit höheren Leistungszielen und geringerer Leiterplattenkomplexität.
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